Verilog :: PLI :: Net

Verilog :: PLI :: Netは、Verilog PLI Tied Net Access Hashです。
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Verilog :: PLI :: Net ランキングとまとめ

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  • Rating:
  • ライセンス:
  • GPL
  • 価格:
  • FREE
  • 出版社名:
  • Wilson Snyder
  • 出版社のWebサイト:
  • http://search.cpan.org/wsnyder/Verilog-Perl-3.035/Parser/Parser.pm

Verilog :: PLI :: Net タグ


Verilog :: PLI :: Net 説明

Verilog :: PLI :: NetはVerilog PLI Tire Net Accessハッシュです。 Verilog :: PLI :: NetはVerilog Pli Tied Net Access Hash.Synopsisを使用Verilog :: PLI :: Netを使用しています。 $ NET {"HIER.SIGNAL"} = 1; "Signal Is"、$ Net {"Hier.Signal"}を印刷します。 Foreach（Keys％Net）{"found" signal $ _n "; （$ NET {"BAD"}）またはDIE "NET 'BAD'は存在しません。" Tie％Plinet、 'Verilog :: PLI :: Net'、 'Top.hiersubMod.pli; "top.hiers.ubmod.pli.something ="、$ plinet {"}、" n ";このパッケージは、Tied Hash％Netを作成し、それはTied Hash％Netを作成し、それはVerilogシグナルからのフェッチまたは保存に影響を与えます。ハッシュキー。 HIEACHYは標準的なドット表記を使用して信号名の前に配置されてもよいし、見つからない場合は、TIEが確立されたときのスコープ、または後のスコープ（）呼び出しが通過した信号名に先行されています。 ％b：％d：％x：または％s：バイナリ、10進数、16進数、または文字列形式の値を返すか設定する。値は、それぞれバイナリまたは16進形式の値を設定するための先行0bまたは0xを持つことができます。 （注）クラスを渡す必要がある場合は、Tied Functionを使用してTied Hashからクラス名に変換します。要件： ・Perl


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