Icarus Verilog.

Verilogシミュレーションと合成ツール
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Icarus Verilog. ランキングとまとめ

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  • Rating:
  • ライセンス:
  • GPL
  • 価格:
  • FREE
  • 出版社名:
  • Stephen Williams
  • 出版社のWebサイト:
  • http://icarus.com/eda/verilog/
  • オペレーティングシステム:
  • Mac OS X
  • ファイルサイズ:
  • 1.1 MB

Icarus Verilog. タグ


Icarus Verilog. 説明

Verilogシミュレーションと合成ツール Icarus VerilogはVerilogシミュレーションと合成ツールです。 それはコンパイラとして動作し、Verilog（IEEE-1364）にあるソースコードをいくつかのターゲットフォーマットにコンパイルします。 バッチシミュレーションの場合、コンパイラはVVPアセンブリと呼ばれる中間形式を生成できます。 この中間フォームは `` vvp ''コマンドによって実行されます。 合成のために、コンパイラは所望の形式でネットワークを生成します。コンパイラの適切なものは、IEEE規格のIEEE STD 1364-2001に書き込まれたデザイン記述を詳しく説明し、解析することを目的としています。 かなり価格の電子形式では、標準的な適切な標準は2001年の半ばにリリースされました。これはかなり大きく複雑な標準です。 Verilogは進行中の作業であり、言語標準がまだ立っていないので、おそらく常にそうなるでしょう。


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