| Verilog RTLパーサー JavaベースのVerilogパーサー |
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Verilog RTLパーサー ランキングとまとめ
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Verilog RTLパーサー 説明
VeriLogParserは、Verilog RTL周辺の独自のユーティリティをデザインしたい人のために開発されたシンプルでアクセス可能で便利なパーサーです。 このパーサは、プラットフォームに依存しないようにするためにJavaで開発されました。 RTLを読み取り、その内部データ構造を入力します。 データベースからデザイン情報を抽出するAPIがあり、式評価機能とともにデザインのすべての要素を詳しく説明するAPIがあります。
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